商品編號：CID1627
商品名稱：Super FinSim V7.1.03 硬體描述語言模擬 英文精簡版
碟片數量：1片
銷售價格：200
瀏覽次數：12129
商品名稱：Super FinSim V7.1.03 硬體描述語言模擬 英文精簡版
碟片數量：1片
銷售價格：200
瀏覽次數：12129
您可能感興趣：
您可能也喜歡：
CB39566"--"Richardson Software RazorSQL 10.4.6 x64 (SQL編輯、資料庫管理軟體) 英文破解版
CB39584"--"Firebird PHP Generator Professional 22.8.0.10 (PHP腳本製作軟體) 英文破解版
CB39723"--"e-World Tech PHPMaker 2024.5 (PHP代碼自動生成軟體) 英文破解版
CB39809"--"SysTools SQL Backup Recovery 11.4 資料庫恢復軟體 英文破解版
CB40088"--"Wing Pro 10.0.2 基於Python編程語言開發的集成開發軟體 英文破解版
Super FinSim V7.1.03 硬體描述語言模擬 英文精簡版
軟體簡介:
Super FinSim V7.1.03 硬體描述語言模擬 英文精簡版
站長安裝測試環境與安裝說明:
‧測試環境 Windows XP Service Pack 2 繁體中文專業版、P4-2.8G 中央處理器
、512Mb 記憶體、NTSF 格式 80.0Gb 硬碟。
‧執行 Autorun.exe 安裝，安裝完成後把光碟 \授權檔 資料夾裡的 FLEXlm 資料夾
複製到硬碟 C:\ 裡裡，然後到控制台 => 系統 => 進階 => 環境變數 => 系統變
數 => 按新增鈕 => 變數名稱填入 FINTRON_LICENSE_FILE => 變數值填入
C:\FLEXlm\license.dat，一樣再新增一個變數名稱 LM_LICENSE_FILE => 變數值
填入 C:\FLEXlm\license.dat，記得按確定鈕儲存設定
Super-FinSim 模擬環境由一個附帶 OVI 的 Virology 編譯器，一個模擬構件和一
個模擬內核組成。
Verilog 編譯器用於【1】檢查設計的句法和語意的正確性，【2】依據設計要求產
生配置模擬內核所要求的原始碼和資料。【3】 選擇性的產生一個供其它應用程式
處理的中間格式表達。模擬構件用於連結構成一個模擬器所需要的所有檔案，例如
，編譯器的輸出和模擬內核。主C連結器用於此目的。模擬內核是所有 Veilog設計
模擬公共原始碼。一旦配置完成，模擬內核就成為一個定制的 Verilog設計的模擬
器。Super-FinSim的模擬器可以執行
Super-FinSim Verilog編譯器有一個快速和強大的能進行廣泛錯誤檢查和恢復的分
析器。此外，分析器能產生標明潛在設計錯誤的警告訊息原始碼，例如，交換一個
越界的數組元素。
